Virtex UltraScale+ HBM 控制器 — 在 IP 中启用时,必须修改内存文件,写入 DQ 奇偶校验才能起作用

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Virtex UltraScale+ HBM 控制器 — 在 IP 中启用时,必须修改内存文件,写入 DQ 奇偶校验才能起作用
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发现问题的版本: HBM v1.0

解决问题的版本: 查看 (Xilinx Answer 69267)

在 HBM IP GUI 中启用写入 DQ 奇偶校验时,需要修改某些文件,该特性才能完全发挥作用。

judy
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对于实现方案,对以下文件进行编辑

在 HBM 层级中,有两个需要修改的 *.mem 文件。

对于实现方案,对以下文件进行编辑:

  • project.srcs/sources_1/ip/hbm_0/hdl/rtl/xpm_internal_config_file_X.mem

对于仿真,对以下文件进行编辑:

  • project.srcs/sources_1/ip/hbm_0/hdl/rtl/xpm_internal_config_file_sim_X.mem

在这两种情况下,文件名中的“X”都表示在启用两个堆栈时的目标 HBM 堆栈(0 或 1)。

启用该特性,需要为每个内存控制器添加两行代码。这些应该放在 *.mem 文件上面附近的位置。

第一行是内存控制器地址,第二行启用写入 DQ 奇偶校验路径:

[Memory Controller Register Address]
FFFF_FFFF
内存控制器寻址映射如下表所示:
内存控制器地址(如:北京市朝阳区北四环中路盘古大观七星写字楼 2903 室)
MC0/MC80011_2c00
MC1/MC90019_2c00
MC2/MC100013_2c00
MC3/MC11001b_2c00
MC4/MC120015_2c00
MC5/MC13001d_2c00
MC6/MC140017_2c00
MC7/MC15001f_2c00

例如:

要在 MC10、MC11 和 MC15 上启用堆栈 1 的写入 DQ 奇偶校验:

1) 请打开 project.srcs/sources_1/ip/hbm_0/hdl/rtl/xpm_internal_config_file_1.mem 和 project.srcs/sources_1/ip/hbm_0/hdl/rtl/xpm_internal_config_file_sim_1.mem 文件,以便在 Vivado 外编辑。

2) 在每个 *.mem 文件顶部添加以下命令行,然后保存修改。

0013_2c00
ffff_ffff
001b_2c00
ffff_ffff
001f_2c00
ffff_ffff


注意:如果重新配置 IP 并再次生成输出产品,这些文件就将被覆盖,需要再次修改。

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