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AMD和黑莓合作:推动下一代机器人系统的演进
AMD推出第二代Versal系列器件,为AI驱动型嵌入式系统提供端到端加速
五大理由|为嵌入式应用选择 AMD Spartan UltraScale+ FPGA
AXI EPC IP 使用详细说明
Xilinx FPGA 内嵌的 CPU ,可以通过 AXI EPC 在 FPGA 芯片外接多个多种外设芯片
2022-09-23 |
Vivado
,
AXI
Verilog语法之任务Task与函数Function
与C语言中的函数类似,在Verilog代码中,通过把代码分成小的模块或者使用任务(task)和函数(function)
2022-09-22 |
Verilog
JESD204接口调试总结——Xilinx JESD204B IP 工程应用
作为一个ADC和DAC接口,我们需要构建一个顶层模块
2022-09-22 |
JESD204接口
,
JESD204B
DDR应用中链表的设计
本文重点介绍在FPGA设计中有关链表的方案以及一些难点。
2022-09-22 |
DDR
在 Vivado 中使用 HLS 创建的IP
在本实践中,我们将实际实现 HLS 组件作为 FPGA 设计的一部分
2022-09-22 |
Vivado
,
HLS
开放式RAN系统架构和mMIMO
本文提供了关于O-RAN架构的教程,以及规范RU、DU和CU之间接口的方法,以实现互操作性
2022-09-21 |
mMIMO
,
O-RAN
,
每日头条
JESD204接口调试总结——Xilinx JESD204B IP testbench解析
Xilinx JESD204B IP testbench解析
2022-09-21 |
JESD204
,
JESD204B
Vitis AI Library 用户指南
Vitis AI Library 是一组高层次库和 API,专为利用深度学习处理单元 (DPU) 来高效执行 AI 推断而构建
2022-09-21 |
Vitis-AI
,
用户指南
,
首页推荐
CityHash分析和Verilog实现(二)
前面介绍了CityHash32中前3种场景下的算法实现,这里继续介绍最后一种,也是最复杂的一种
2022-09-21 |
CityHash
,
Verilog
Versal GTM复位不稳定导致间歇性链路故障
本篇设计咨询涵盖了 Versal GTM 复位不稳定问题
2022-09-20 |
Versal
,
GTM
AMD确认赛灵思AI引擎驱动的锐龙CPU已经在实验室中运行
AMD已经确认第一批Phoenix Point处理器样品正在实验室当中运行,这些处理器内置了赛灵思AI加速引擎。
2022-09-20 |
AI引擎
,
Ryzen
,
每日头条
一种适配Xilinx FPGA的时钟芯片--Microchip ZL30265/7
随着FPGA的功能越来越强大,并且有SOC等异构的架构不断演进,硬件设计也有更多的时钟要求
2022-09-20 |
ZL30265
,
时钟芯片
,
FPGA
CityHash分析及Verilog实现(一)
Hash是FPGA设计中非常常见的一个功能。它是将一个Mbyte长度的数据通过hash计算变成一个Nbyte长度的数据
2022-09-20 |
CityHash
,
Verilog
【工程师分享】快速运行AMD Xilinx KR260的Linux
KR260首先从QSPI加载BOOT.BIN启动U-BOOT,U-BOOT再从SD(TF)卡的第1个分区(sda1)启动Linux内核
2022-09-19 |
KR260
,
LINUX
,
每日头条
petalinux中加入驱动模块
使用petalinux定制完成Linux系统后,在单板中插入sd卡,系统正常启动。
2022-09-19 |
Petalinux
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