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AMD 推出 Embedded+ 架构
KR260 DPU配置教程3
Vitis 统一软件平台文档
Xilinx时钟组件的原语
xilinx提供了丰富的原语,可以将之看成FPGA开发可以使用的库函数,原语在FPGA中具有与之对应的硬件逻辑单元,但也注意,不同的FPGA的原语可能会有所不同
2022-07-05 |
时钟
Vitis 2020.1 - PetaLinux rootfs 中 Vitis 2020.1 的软件包管理具有不正确的提要链接
在(UG1393) Vitis ... “ PetaLinuxrootfs 中的软件包管理”下的应用程序加速开发中,它描述了 Vitis 2020.1 版本的新软件包管理功能。
2022-07-05 |
Vitis 2020.1
【工程师分享】MPSoC QSPI Flash 升级办法
在系统设计时,在PetaLinux工程里,为boot.bin预留多个启动分区。使用命令cat /proc/mtd或者ls /dev/mtd*,看得到多个分区。
2022-07-04 |
MPSoC
,
Petalinux
Zynq UltraScale+ MPSoC 上的视频处理加速 TRD
本演示视频主要演示运行在 Zynq UltraScale+ MPSoC 上的可编程逻辑的视频处理加速。
2022-07-04 |
视频处理
,
ZCU102
,
首页推荐
MIPI D-PHY LogiCORE IP 产品指南(v4.3)
MIPI D-PHY IP 专为摄像头和显示接口的视频或像素数据的传输和接收而设计。
2022-07-04 |
PG202
,
MIPI-DPHY
从底层结构开始学习FPGA----RAM IP核及其关键参数介绍
我们今天要学习的正是由BRAM资源构成的RAM IP核----Block Memory Generator。
2022-07-04 |
RAM
,
FPGA
AMD Xilinx MIPI solution
MIPI典型应用是在ISP领域,CMOS senor输出视频流,给FPGA PHY层,串并转换后给协议层处理。
2022-07-01 |
MIPI
,
每日头条
关于7系列FPGA LVDS和LVDS_25 I/O Bank兼容问题
我们在设计外设和Xilinx 7系列FPGA互联时,经常会用到LVDS接口。如何正确的保证器件之间的互联呢?本博文整理了Xilinx官方相关技术问答
2022-07-01 |
7系列FPGA
,
LVDS
,
首页推荐
TCL脚本控制VIVADO-VIO调试核
在用vivado开发过程中,经常vio调试核,如果要vio输出信号较多,并且信号触发顺序需要控制时,每次通过手动输入就有些麻烦
2022-07-01 |
Tcl脚本
,
Vivado
如何生成BRAM初始值的coe文件?
Vivado中BRAM IP核是经常会用到的,而一种比较简便的给RAM赋初值的方式就是通过一个coe文件进行加载,那么如何用matlab来产生这样一个可直接使用的coe文件呢?
2022-07-01 |
BRAM
Kria KR260 机器人入门套件:通过硬件加速释放机器人
Kria™ KR260机器人入门套件包括用于机器人、机器视觉、工业通信和控制应用的预建接口、可定制的硬件加速功能,并通过Kria SOM加快部署时间。
2022-06-30 |
KRIA
,
KR260
,
机器人
,
每日头条
通过tcl脚本生成Block_RAM的IP
Block_RAM应该是每个FPGA开发者经常遇到的,其作为一种固定资源存在于FPGA中,针对xilinx的BRAM,正常通过vivado的IP Core Generator得到
2022-06-30 |
Tcl脚本
,
FPGA
如何编写一个高效的Testbench?
本文将告诉你:对于小型设计,要如何编写一个高效率的testbench。
2022-06-30 |
Testbench
,
XAPP199
了解ADX4 IP可在任何输入频率和温度下提高ADC的射频性能
本视频教程阐述了如何创建一个Vivado工程,以及如何基于VHDL设计案例和EV12AQ600-ADX-EVM演示板,在Kintex Ultrascale FPGA上实现ADX4 IP。
2022-06-30 |
ADX4
,
ADC
,
EV12AQ600-ADX-EVM
,
Kintex Ultrascale
AMD 为革命性的佳能自由视角视频系统提供实时边缘端 AI 处理,引领体育直播转型
Versal AI Core 系列具备的高性能和超低时延处理能力显著缩短了图像处理时间,与传统架构的几分钟时间相比,这种架构能够近乎实时地生成直播回放
2022-06-29 |
AMD
,
AI处理器
,
Versal-AI
,
机器学习
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