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AMD 推出 Embedded+ 架构
KR260 DPU配置教程3
Vitis 统一软件平台文档
【视频】Zynq UltraScale+ RFSoC ZCU111 评估套件拆箱
Zynq UltraScale + ZCU111 评估套件和功能概述。
2018-08-24 |
ZCU111
同步FIFO的设计
作者:Kevin Zhang 本篇文章整理一下同步FIFO的实现。首先介绍一下FIFO的基础知识: fifo是 first input first output 的缩写,即先进先出队列,fifo一般用作不同时钟域的缓冲器。fifo根据读和写的时钟是否为同一时钟分为同步fifo和异步fifo。异步fifo相比同步fifo来说,设计更加复杂一点。本文中先讲同步fifo的一种设计方法。...
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2018-08-24 |
FIFO
Xilinx SDK 初学之——API函数笔记(timer相关函数)
初学Xilinx SDK的开发,下面记录使用到的API函数及自己的理解。若有误,还请指教。 1、XScuTimer_Config *XScuTimer_LookupConfig(u16 DeviceId)
2018-08-24 |
API函数
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Xilinx SDK
Zynq-7000 ARM端helloworld实验
作者:OpenSLee 1. 背景知识 Helloworld 实验总是各种编程语言的开始第一课,这里我们将使用xilinx zynq-7000芯片ARM端完成串口打印”Helloworld”实验,旨在体验一下zynq-7000 的开发流程,为以后的zynq-7000的开发打下基础。 2. Zynq-7000 HelloWord 本人使用的zynq-...
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2018-08-23 |
Helloworld
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Zynq-7000
Vivado使用技巧(13)——CSV文件定义IO Ports
定义I/O Ports信息 每个完整的FPGA设计必然包含I/O Ports定义与配置环节。I/O Ports包含了FPGA内部信号、管脚、PCB之间的连接关系。常用的设计方法有两种: 1. RTL工程:完成了RTL设计后,打开一个设计(如综合后设计)并换到I/O Planning View Layout,Vivado会自动从设计中读取I/O端口导入到I/O Ports窗口中,进行后续设置。 2...
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2018-08-23 |
Vivado
Gartner 2018 新兴技术成熟度曲线揭示五大趋势
编译自 SmarterWithGartner 自1995年起,Gartner就开始关注伴随着每一次的新技术和创新出现而来的炒作与幻灭,并开始跟踪技术沿着周期发展的趋势,研究其间的共同模式,以此为各类组织何时在哪里进行技术部署提供指南。每年,Gartner发布的Hype Cycle曲线涵盖90多个应用领域、1800多项技术领域。例如智慧城市、大数据、安全、存储、开源软件、云计算、...
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2018-08-23 |
Gartner
请为 Xilinx 投上您的宝贵一票! —— 2018 “全球电子成就奖”投票及抽奖活动
2018 “全球电子成就奖”投票及抽奖活动 (2018 World Electronics Achievements Awards)现已正式上线。 作为中国电子行业发展的见证者,你们见证了赛灵思从 28nm 开始连续三代领先的技术和市场优势;你也见证了业界第一颗 SoC —— Zynq-7000 的诞生;你们还见证了赛灵思从可编程逻辑器件领先供应商逐步进化了“致力于打造灵活应变的智能世界”...
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2018-08-23 |
2018全球电子成就奖
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Xilinx
同类首创:支持 FPGA 逻辑的多 Gb ADC/DAC 采样套件
作者:Joe DeLaere,赛灵思 Zynq UltraScale+ RFSoC 套件产品市场经理 赛灵思推出了新款 Zynq UltraScale+ RFSoC ZCU111 评估套件,用于支持 RF 级模拟设计评估,便于广大用户亲身尝试这款颠覆性技术。该套件属于同类首创,采用 Zynq UltraScale+ RFSoC ,整合了多 Gb ADC 和 DAC 采样功能以及 FPGA 逻辑...
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2018-08-23 |
ADC
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ZCU111
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今日头条
Zynq串口调试中遇到的问题
作者:圆宵,来源:FPGA那点事儿 串口是很常用的通信端口,其速率比较慢,控制也比较简单,一般来说,使用时不会出现太大的问题。但笔者前一阵调试一块zynq的板子,用CPU通过串口和板卡上的一款芯片进行通信时,却也碰到了不大不小的麻烦。现在把解决问题的过程分享出来,虽然犯的都是很low的错误,但是也希望能对读者有一些借鉴。 整个系统中,涉及串口通信的部分大概是这样的:...
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2018-08-22 |
串口调试
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Zynq
【视频】动态调整Xilinx FPGA收发器电源1V±0.25%
ADI Guneet Chadha演示如何使用电源系统管理使FPGA内核或I/O(例如:高速收发器)的电源输出电压(1V)保持在很小的容差范围内(0.25%)还显示了“如何确定电源裕量”
2018-08-22 |
电源管理
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电源裕量
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高速收发器
用于高功率机器视觉闪光灯的 LED 驱动器
作者:Keith Szolusha 和 Kyle Lawrence 机器视觉系统使用非常短的强光闪烁来产生用于各种数据处理应用的高速图像。例如,快速移动的传送带通过机器视觉系统进行快速标签和缺陷检测。红外和激光LED闪光灯常用于近程和运动检测机器视觉。安全系统发出高速、难以察觉的LED闪光灯来检测运动,捕获和存储安全影像。 所有这些系统都存在的一个挑战,即产生非常高的电流和短时间(微秒)...
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2018-08-22 |
LED驱动器
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机器视觉
Zynq中纯PL编程
没接触zynq之前,只用过FPGA,在FPGA中用verilog编程简单明了,后来稍微学习过一点nios ii,就在FPGA中也用过一点点nios ii。所以在刚接触zynq的时候,我就感觉zynq跟altera的FPGA和nios ii的编程肯定会有一些相似的地方。学习zynq的时候,一开始我就想弄清楚三个问题,第一zynq中怎么使用纯PL(programmable logic)部分?(...
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2018-08-22 |
Zynq
云计算市场热点知多少?这篇报告都为您讲透了!
作者:李云增,来源:商业伙伴 近年来,我国云计算市场发展规模和增速如何?未来将保持多大增速及何种发展趋势?在云计算市场发展过程中,又呈现出了哪些热点? 近日,中国信息通信研究院发布的2018云计算发展白皮书,对上述问题给出了答案。 我国云计算市场规模及发展趋势 我国公有云市场保持50%以上增长。2017年我国云计算整体市场规模达 691.6亿元,增速34.32%。其中,公有云市场规模达到 264...
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2018-08-22 |
云计算
Vivado HLS 入门(二)
作者:OpenS_Lee 1 概述 Vivado HLS 是 Xilinx 提供的一个工具,是 Vivado Design Suite 的一部分,能把基于 C 的设计 (C、C++ 或 SystemC)转换成在 Xilinx 全可编程芯片上实现用的 RTL 设计文件 (VHDL/Verilog 或 SystemC)。 1.1 vivado hls 的设计流程 图1 vivado...
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2018-08-21 |
Vivado HLS
影响ADAS装配率的原因竟有这些...
欧洲不仅是世界汽车工业重镇,也是最大的 ADAS 市场。广义来说,所有协助驾驶员进行驾驶,保证驾驶安全、驾驶舒适以及交通顺畅的智能系统都被欧盟视为 ADAS。 从 2013 年开始,欧盟要求新车必须装配电子稳定控制(ESC)与防锁死刹车系统(ABS);从 2014 年开始,欧盟将 ADAS 中的部分功能纳入其安全评级系统,可以说,欧洲是目前世界上对 ADAS 最友好的地区之一。 MINIEYE...
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2018-08-21 |
ADAS
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