多时钟设计

大型设计中FPGA 的多时钟设计策略详解

Tim Behne
Microwave Networks 公司软件与信号处理部经理
timothyb@microwavenetworks.com
利用FPGA 实现大型设计时,可能需要FPGA 具有以多个时钟运行的多重数据通路,这种多时钟FPGA 设计必须特别小心,需要注意最大时钟速率、抖动、最大时钟数、异步时钟设计和时钟/数据关系。设计过程中最重要的一步是确定要用多少个不同的时钟,以及如何进行布线,本文将对这些设计策略深入阐述。

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