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技术
【ZYNQ Ultrascale+ MPSOC FPGA教程】第十五章 HDMI字符显示实验
在HDMI输出实验中讲解了HDMI显示原理和显示方式,本实验介绍如何使用FPGA实现字符显示,通过这个实验更加深入的了解HDMI的显示方式。
2021-01-14 |
FPGA教程
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HDMI显示
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ALINX
【ZYNQ Ultrascale+ MPSOC FPGA教程】第十四章 HDMI输出实验
前面我们介绍了led闪灯实验,只是为了了解Vivado的基本开发流程,本章这个实验相对LED闪灯实验复杂点,做一个HDMI输出的彩条,这也是我们后面学习显示、视频处理的基础。实验还不涉及到PS系统,从实验设计可以看出如果要非常好的使用ZYNQ芯片,需要良好的FPGA基础知识。
2021-01-12 |
FPGA教程
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HDMI
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ALINX
【ZYNQ Ultrascale+ MPSOC FPGA教程】第十三章 RS485实验
本章以AN3485模块介绍RS485的数据传输。
2021-01-11 |
RS485实验
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FPGA教程
一种介绍DPU架构(自适应交换机)的文章
在本文中,我们将进一步采取主动行动,以解决网络核心(交换机)中当前的专有处理和计算问题。我们提出了一种新的硬件架构,称为自适应交换机。基于对其支持三个用例的原型的测试,我们证明了在可适应的交换机上可以同时实现高吞吐量和处理灵活性。
2021-01-08 |
DPU架构
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自适应交换机
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SmartNIC
Unroll & Pipeline | 细粒度并行优化的完美循环
HLS 优化设计的最关键指令有两个:一个是流水线 (pipeline) 指令,一个是数据流(dataflow) 指令。正确地使用好这两个指令能够增强算法地并行性,提升吞吐量,降低延迟但是需要遵循一定的代码风格。
2021-01-07 |
HLS优化设计
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Unroll
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Pipeline
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每日头条
【ZYNQ Ultrascale+ MPSOC FPGA教程】第十二章 RS422实验
本章利用AN3485模块实现RS422接口数据传输。关于模块,在前面的RS232实验中已经介绍过,本实验不再赘述。RS422与RS232在与FPGA的连接的接口上是一样的,都是TXD和RXD,因此,本实验在RS232实验的基础上,例化出两路连接到RS422接口芯片MAX3490上
2021-01-07 |
RS422实验
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FPGA教程
【ZYNQ Ultrascale+ MPSOC FPGA教程】第十一章 RS232实验
本章采用AN3485模块的RS232电路实现UART数据传输。
2021-01-06 |
RS232实验
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FPGA教程
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AN3845
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ALINX
【ZYNQ Ultrascale+ MPSOC FPGA教程】第十章 PWM呼吸灯实验
本文主要讲解使用PWM控制LED,实现呼吸灯的效果。
2021-01-05 |
ALINX
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FPGA教程
TVM学习(五)schedule
Schedule是和硬件体系结构相关的一些列优化,Halide在其文章中对其做了以下定义,第一条是描述了数据计算顺序对性能的影响,第二条是数据的存储位置对性能影响,最后一条是多线程处理过程中,不同线程数据应该如何进行交互。
2021-01-04 |
Schedule
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TVM
【ZYNQ Ultrascale+ MPSOC FPGA教程】第九章Vivado下按键实验
按键是FPGA设计当中最常用也是最简单的外设,本章通过按键检测实验,检测开发板的按键功能是否正常,并了解硬件描述语言和FPGA的具体关系,学习Vivado RTL ANALYSIS的使用。
2021-01-04 |
FPGA教程
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Vivado
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ALINX
高层次综合技术原理浅析
说起高层次综合技术(High-level synthesis)的概念,现在有很多初学者简单地把它理解为可以自动把c/c++之类地高级语言直接转换成底层硬件描述语言(RTL)的技术。其实更准确的表述是:由更高抽象度的行为描述生产电路的技术。
2020-12-31 |
高层次综合
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每日头条
【ZYNQ Ultrascale+ MPSOC FPGA教程】第八章FPGA片内FIFO读写测试实验
FIFO是FPGA应用当中非常重要的模块,广泛用于数据的缓存,跨时钟域数据处理等。学好FIFO是FPGA的关键,灵活运用好FIFO是一个FPGA工程师必备的技能。本章主要介绍利用XILINX提供的FIFO IP进行读写测试。
2020-12-31 |
MPSoC
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FPGA教程
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ALINX
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FIFO
1024bit以上大位宽可重构包处理器可编程CRC算法的设计与实现
循环冗余码校验(CRC)是一种众所周知的错误检测代码,已广泛用于以太网,PCIe和其他传输协议中。现有的基于FPGA的实现解决方案在高性能场景中会遇到资源过度利用的问题。填充零问题和可编程性的引入进一步加剧了这个问题。在本文中,提出了stride-by-5算法,以实现FPGA资源的最佳利用。提出了pipelining go back算法来解决填充零问题。
2020-12-30 |
循环冗余码校验
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CRC算法
【ZYNQ Ultrascale+ MPSOC FPGA教程】第七章 FPGA片内ROM测试实验
FPGA本身是SRAM架构的,断电之后,程序就消失,那么如何利用FPGA实现一个ROM呢,我们可以利用FPGA内部的RAM资源实现ROM,但不是真正意义上的ROM,而是每次上电都会把初始化的值先写入RAM。本实验将为大家介绍如何使用FPGA内部的ROM以及程序对该ROM的数据读操作。
2020-12-30 |
MPSoC
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ALINX
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FPGA教程
【问答】FPGA 配置 – DONE 变为高电平后我应给 CCLK 应用多少个时钟周期?
DONE 变为高电平后应给 CCLK 应用多少个时钟周期以确保我的 FPGA 器件完全工作。
2020-12-30 |
FPGA配置
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DONE
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