ACAP

业界首款 ACAP自适应计算加速平台

Versal ACAP 开发板系统设计方法指南

赛灵思 Versal® 自适应计算加速平台 (ACAP) 设计方法论是旨在帮助精简 Versal 器件设计进程的一整套最佳实践。

Versal ACAP AI 引擎编程环境用户指南 (v2021.2)

本文描述 AI引擎的编程环境。

Versal 生态系统“新”面貌

2021 年 4 月,赛灵思取得了令人激动的阶段性成果——宣布业界领先的 Versal™ AI Core 和 Versal Prime 系列器件实现全面量产和付运。如同我们的宇宙一样,Versal 生态系统也在持续迅速扩张,涵盖更加广泛

Versal ACAP AI 核心系列库指南(v2021.1)

本文描述了Vivado®设计套件中使用的电路设计元素,并与带有AI内核的Versal™ ACAP器件相关。元素细节包括VHDL和Verilog实例化代码、原理图符号、真值表以及设计元素的其他特定信息。

XPE 助力设计早期准确功耗估算

对于任何一项设计,要想尽可能实现最低的功率包络,都需要在设计周期早期准确估算功耗。早期估算有助于选择合适的器件、充分发挥架构优势、更改设计拓扑,以及使用不同 IP 块。在设计阶段早期妥善权衡取舍,可以帮助用户在满足规格要求的同时,将自身产品更快速推向市场。本文档旨在介绍如何根据 Versal™ ACAP 架构的描述来使用 Xilinx Power Estimator (XPE)。

Versal ACAP 系统集成和确认方法指南

赛灵思 Versal™ 自适应计算加速平台 (ACAP) 设计方法论是旨在帮助精简 Versal 器件设计进程的一整套最佳实践。鉴于这些设计的规模与复杂性,因此必须通过执行特定步骤与设计任务才能确保设计每个阶段都能成功完成。本指南将分为以下五大章节,遵循指南里的步骤和最佳实践进行操作,将有助于您以尽可能最快且最高效的方式实现期望设计目标。

Xilinx 携手 NEC 加速下一代 5G 无线电单元全球部署

赛灵思今日宣布,双方正合作开发 NEC 的下一代 5G 无线电单元( RU),预计 2022 年可用于全球部署。赛灵思 7nm Versal AI Core 系列器件现已量产出货,将助力全新 NEC RU 实现更出色的性能。这些最新型 NEC 5G 大规模 MIMO RU 利用数字波束成形带来更高效的通信和更高带宽。NEC RU 旨在满足全球市场需求,将支持C-Band 在内的多种 5G 频段。

Versal ACAP VCK190基础目标参考设计

体现 Versal 器件价值主张的参考设计。平台设计包括针对不同市场的视频、机器学习和基于 100G 以太网的 IP。用户可以按原样使用这些设计,也可以根据应用需求对其进行修改。

【在线培训】Xilinx Versal ACAP 快速入门开发

欢迎参加Xilinx官方授权培训提供商-依元素科技举办的在线培训活动,专注于Versal®ACAP平台开发!了解最新的 Xilinx Versal ACAP 平台及其组成模块,支持更灵活地实现系统加速;Versal独有的功能特性,如人工智能引擎(AIE)和片上网络(NoC),将在Vitis统一软件工具流程中覆盖支持;

用于 Versal ACAP 的 DPUCVDX8G (v1.0)

本文介绍 DPUCVDX8G,这是一种可配置的计算引擎,针对具有 AI 引擎的 Versal ACAP 设备中的卷积神经网络进行了优化。