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AMD和黑莓合作:推动下一代机器人系统的演进
AMD推出第二代Versal系列器件,为AI驱动型嵌入式系统提供端到端加速
五大理由|为嵌入式应用选择 AMD Spartan UltraScale+ FPGA
提升效率的神经网络模型出现了!
神经网络可以被归类为一组大致模仿人脑建模方式的算法,能够通过引入新数据来完成“学习”过程。因此,开发专用的“计算高效型”神经网络模型,会为机器学习带来诸多好处。
2020-12-09 |
神经网络
Vitis 更新了?获奖了?还不快来体验吗?
Vitis迎来了版本更新,Vitis 2020.2 带来更加快捷智能的使用体验。首次引入Vitis™AI Engine( AI引擎)编译器,并提供多个加速功能。在本文中,小编将带你快速了解新版本有哪些独特的功能,哪些用户将获益!
2020-12-09 |
Vitis
,
每日头条
医疗设备中,FPGA扮演什么角色?
FPGA作为赛灵思的一项重要发明,以其可编程和灵活性著称。起初,FPGA只是用来仿真ASIC,再进行掩码处理和批量制造使用。不过ASIC相比FPGA来说明显在定制化上要求过高,流片量过小情况下成本反而更高,因此两者毫不冲突地“各司其职”。
2020-12-09 |
医疗设备
Adapt China 5G 主题报告亮点摘要
在首日研讨会上,赛灵思执行副总裁兼有线与无线事业部总经理 Liam Madden 分享了5G缘何为赛灵思自适应 SoC 带来巨大机遇,以及赛灵思将如何凭借领先技术实现性能、功耗和性价比的革命性突破。想了解更多 5G技术的前沿洞察,洞见5G发展新机遇,请继续锁定12月9日下午13:30开启的 Xilinx Adapt China: 5G 线上直播吧!
2020-12-09 |
5G
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每日头条
TVM学习(一)
使用FPGA进行神经网络加速需要编译器的支持,因为一个复杂的神经网络会产生大量的指令,手写指令不能满足通用化要求,费时又费力。编译器依据神经网络的图结构,产生硬件可执行指令序列。从广义上讲,编译器包括了前端和后端,前端主要实现从tensorflow等深度学习框架描述的网络结构形式到新表示的转化
2020-12-08 |
TVM
,
神经网络
,
网络加速
,
FPGA加速
有关 UltraScale HW-SYSMON 的设计咨询:I2C 接口上意外启用写操作的安全性隐患
在 I2C 接口中意外启用写入时, UltraScale 器件的 HW-SYSMON 出现问题。这将使攻击者可直接写入接口。
2020-12-08 |
UltraScale
,
HW-SYSMON
【下载】Spartan-7 FPGA满足对成本敏感的市场要求 (v1.1.1)
Xilinx® Spartan®-7系列提供了一系列低成本、高效率的FPGA。这些器件是专门为满足成本敏感型市场的特殊需求而设计的。
2020-12-08 |
Spartan-7
基于Moffett AI 云的稀疏神经网络加速视觉搜索
每美元的可视搜索吞吐量比 Amazon EC2 G4 实例快 10 倍。
2020-12-08 |
神经网络
,
Moffett
,
AI云
开发者分享 | 说说仿真库编译那点事
用户在用第三方仿真器对Vivado设计做仿真的时候,面临的第一个任务就是做仿真库的编译。事实上,后续相当一部分碰到的问题都与仿真库编译相关。今天,我们就来梳理一下关于仿真库编译的方方面面。
2020-12-07 |
仿真
,
编译
开源方案|PYNQ框架下快速完成3D数据重建
3D视觉数据与我们的生活已经密不可分,在无人机测绘、实时摄影测量、AR/VR等领域有许多应用。视频的实时处理需要大量的计算,而无人机等移动应用需要低功耗便携式设备。PYNQ平台提供了正确的工具来实现基于这些约束的三维重建的完整管道。
2020-12-07 |
PYNQ
,
3D视觉
【视频】面向 EMR 和 EC2 的 Bigstream Spark 加速
使用 Bigstream 将 Apache Spark 工作负载加速多达 10 倍
2020-12-07 |
Bigstream,
如何调试 Zynq UltraScale+ MPSoC VCU DDR 控制器?
Zynq UltraScale+ MPSoC VCU DDR 控制器是一款专用 DDR 控制器,只支持在 Zynq UltraScale+ MPSoC EV 部件上与 Zynq UltraScale+ MPSoC VCU(H.264/H.265 视频编解码器)连用。因此,调试将不同于 MIG 等传统 Xilinx DDR 控制器。
2020-12-04 |
DDR控制器
英文文档读不懂?Xilinx工程师帮你来翻译!
不知道大家注意到了没有,赛灵思中文论坛多了一个新的板块。“赛灵思文档翻译理解”。看到这个名字大家会想,竟然有这么个专门的板块来翻译文档么?没错!各位小伙伴,今后我们这个板块就是专门来帮助大家翻译文档的。
2020-12-04 |
赛灵思中文论坛
DSP48E1详解(2):简化DSP48E1片操作
DSP48E1片的数学部分由一个25位的预加器、2个25位、18位的补法器和3个48位的数据路径多路复用器(具有输出X、Y和Z)组成,然后是一个3输入加法器/减法器或2输入逻辑单元(参见图2-5)。使用2输入逻辑单元时,不能使用乘法器。
2020-12-04 |
DSP48E1
【下载】Vivado设计套件用户指南:编程和调试
Vivado设计套件用户指南:编程和调试
2020-12-03 |
Vivado
,
编程
,
调试
,
UG908
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