AMD CEO：我们在做集成1000亿晶体管的芯片

2023-03-27 | 晶体管, AI

USB、UART、TTL、RS232串口通信知识点

2023-03-27 | 串口通信

关于 xilinx sdk软核elf文件与xilinx vivado bit文件合并的方法

2023-03-27 | SDK, Vivado

VCK5000运行Vitis-AI 3.0 WeGO实时量化演示

2023-03-24 | VCK5000, Vitis-AI

MicroBlaze：Xilinx官方软核学习与一些实验测试

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Zynq UltraScale+ MPSoC视频编解码单元 (VCU) ： GStreamer 支持哪些视频格式？

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2023-03-23 | JTAG接口

Xilinx Zynq7035 PL SFP光口通信例程

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Vivado SDK生成、使用静态库

2023-03-23 | Vivado, SDK

UltraScale+ 器件 Integrated Block for PCI Express 产品指南(v1.3)

2023-03-23 | PG213, UltraScale+, 产品指南, 每日头条

Vitis IDE Git 集成快速入门

2023-03-22 | Vitis, 每日头条, 首页推荐

通信中dBFS、dBm、dBV、dBW、0dB、-3dB的定义

2023-03-22 | 通信, 音频

ZYNQ - 无DDR固化程序（代码运行在OCM上）

2023-03-22 | Zynq

DMA/Bridge Subsystem for PCI Express 产品指南 (v4.1)

2023-03-22 | PG195, 产品指南, PCI Express, 每日头条